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MSC711x DSP TDM与DMA配置实战：实现多通道音频数据高效搬运

news 2026/6/9 15:35:04

1. 项目概述：当TDM遇上DMA，如何让MSC711x DSP的数据吞吐飞起来？

在嵌入式音频处理、电信网关或者任何需要处理多路数字音频流的场景里，你肯定遇到过这样的问题：CPU吭哧吭哧地搬运数据，结果宝贵的MIPS（每秒百万条指令）全耗在I/O上了，真正用于算法处理的算力所剩无几。如果你正在使用Freescale（现NXP）的MSC711x系列DSP，那么恭喜你，你手头有一个强大的武器组合——时分复用（TDM）接口和直接内存访问（DMA）控制器。这个组合拳能把你从繁琐的数据搬运中解放出来，让数据像坐上了高速传送带一样，在内存和外设之间自动、高效地流转。

我最早在做一个VoIP媒体网关项目时，需要处理多达128路的E1时隙语音数据。如果每路数据都让CPU去读TDM寄存器、再写入内存，那系统早就卡成幻灯片了。正是通过深入研究MSC711x的TDM和DMA机制，才实现了稳定、低延迟的百路语音处理。今天，我就把自己踩过的坑、调通的参数和验证过的代码，掰开揉碎了分享给你。无论你是要对接E1/T1 framer芯片，还是要构建一个多通道音频矩阵，这篇文章都能帮你把MSC711x的TDM+DMA这套组合拳打好。

简单来说，TDM负责把多路数据流打包成一条高速串行流，而DMA则负责在后台默默地把这些数据搬到正确的地方，全程无需CPU干预。这听起来简单，但里面的门道可不少：时钟怎么生成才精准？帧同步信号如何对齐？数据是交织存放还是解交织存放更高效？DMA通道又该如何配置才能实现“乒乓缓冲”或定期中断？别急，我们一步步来。

2. TDM模块深度解析：不止是串口那么简单

很多人会把TDM接口简单地理解为一个“多通道串口”，这其实低估了它的能力。MSC711x的TDM模块是一个高度可配置的同步串行通信引擎，专为高密度、实时数据流设计。理解它的架构，是进行一切高级配置的基础。

2.1 核心架构与数据通路

MSC711x的TDM模块在设计上充分考虑了灵活性和性能。其核心是一个双工（全双工）的串行通信引擎，分为独立的发送（Tx）和接收（Rx）两部分。这两部分可以共享时钟和帧同步信号，也可以独立工作，这为连接不同时序要求的设备提供了可能。

从数据通路来看，发送数据从内部的发送数据寄存器（TDMxTDR）出发。这里有一个关键设计：一个4行深的发送FIFO。启用这个FIFO（通过设置TDMxTIR[TFEN]位）是实现稳定、无丢失数据传输的关键。当DMA来不及填充数据时，FIFO可以作为缓冲，防止TDM接口“断流”。数据从TDR或FIFO进入发送移位寄存器，然后在时钟驱动下，从TDMxTD引脚一位一位地移出。如果启用了A-law或μ-law压缩，硬件编解码器（Compander）会自动将16位线性PCM数据压缩成8位对数格式，这对于电信应用是极大的便利。

接收端则是一个镜像过程。数据从TDMxRD引脚移入接收移位寄存器，凑齐一个时隙的数据（8或16位）后，存入接收数据寄存器（TDMxRDR）或接收FIFO。同样，如果检测到压缩数据，硬件会自动将其扩展为线性格式。整个数据通路通过64位的ASTH总线与内存系统连接，而配置寄存器则通过32位的APB总线访问，这种分离保证了配置灵活性和数据高带宽。

实操心得：FIFO水位的艺术发送和接收FIFO的水位（Watermark）设置，是平衡响应速度和中断频率的杠杆。以发送为例，TDMxTIR[TFWM]位控制何时触发“FIFO空”事件（进而触发DMA请求）。如果设置为00（FIFO中有一个或以上空位就触发），那么DMA响应会非常及时，数据断流风险低，但中断/DMA请求频率会很高。如果设置为11（FIFO完全空才触发），则DMA请求频率最低，但对DMA服务的延迟要求也最苛刻，一旦DMA响应慢，就可能出现“下溢”（Underflow），输出错误数据。我的经验是，在系统负载较轻或DMA优先级最高时，可以设为00以求最稳；在系统复杂、DMA可能被阻塞时，设为01或10（半空触发）是更保险的选择，为DMA响应留出一些时间余量。

2.2 信号定义与GPIO复用配置

每个TDM模块对外暴露6个信号引脚，它们是连接外部世界的物理桥梁：

  • TDMxTCK/RCK：发送/接收位时钟。数据在此时钟的边沿被采样或驱动。
  • TDMxTFS/RFS：发送/接收帧同步信号。一个脉冲标志着一帧数据的开始。
  • TDMxTD/RD：发送/接收数据线。

这些引脚与GPIO复用，因此上电后第一件事就是正确配置引脚功能。MSC711x的GPIO配置稍显繁琐，需要操作四个寄存器：设备配置寄存器（DEVCFG）、端口控制寄存器（PxCTL）、数据方向寄存器（PxDDR）和数据寄存器（PxDR）。

对于TDM0和TDM1，它们使用GPIO A口的“次要功能”（Secondary Function）。你需要将DEVCFG寄存器中的PAS（Port A Select）位清零。然后，在PACTL寄存器中，将对应引脚的控制位设置为1，以选择外设功能而非GPIO功能。例如，TDM0的6个信号占用PA[11:6]，那么就需要设置PACTL[11:6] = 0xFC0。最后，将PADDR和PADR中对应位清零，因为方向和数据由TDM模块控制。

对于TDM2，情况特殊一些，它使用了GPIO A口和D口的“附加功能”（Additional Function）。此时，需要将DEVCFG中的PAS和PDS位都置1。然后，TDM2TCK、TDM2RFS、TDM2TD在PD口（PDCTL[6:4]），TDM2RCK、TDM2TFS、TDM2RD在PA口（PACTL[29:27]），需要分别设置。

下面是一个配置TDM0、TDM1和TDM2引脚功能的代码示例，它清晰地展示了如何操作这些寄存器：

void InitGPIO(void) { GPIO *pstGPIO; BTM *pstBTM; pstGPIO = (GPIO *)(GPIO_BASE); pstBTM = (BTM *)(BTM_BASE); // 配置TDM0和TDM1（使用GPIO A口的次要功能） // 将PA[11:0]配置为外设功能，方向和数据寄存器清零 pstGPIO->astPort[0].vuliPortControl = 0x00000FFF; // PACTL[11:0] = 1 pstGPIO->astPort[0].vuliPortDataReg = 0; pstGPIO->astPort[0].vuliPortDataDirReg = 0; // 为TDM2配置芯片功能选择（使用附加功能） // 设置DEVCFG寄存器的PAS和PDS位 pstBTM->vuliCHPCFG = pstBTM->vuliCHPCFG | 0x00000009; // 配置TDM2在PA口的引脚：T2TFS(PA29), T2RD(PA28), T2RCK(PA27) pstGPIO->astPort[0].vuliPortControl = pstGPIO->astPort[0].vuliPortControl | 0x38000000; // 配置TDM2在PD口的引脚：T2TD(PD6), T2TCK(PD5), T2RFS(PD4) pstGPIO->astPort[3].vuliPortControl = pstGPIO->astPort[3].vuliPortControl | 0x00000070; }

注意事项：上电默认状态芯片复位后，所有引脚默认为GPIO输入且上拉。在配置为TDM功能前，如果外部设备已经开始发送时钟和数据，可能会在GPIO引脚上产生不必要的电流或信号冲突。安全的做法是，在系统初始化早期就完成GPIO的功能配置，或者确保外部设备在DSP初始化完成后再启动。

2.3 时钟与帧同步：系统的节拍器

TDM通信的基石是精确的时钟和帧同步。时钟（TDMxTCK/RCK）决定了每一位数据的时间长度，帧同步（TDMxTFS/RFS）则告诉接收方一帧数据从哪里开始。

时钟生成有两种模式：外部输入和内部生成。对于需要主导通信时序的设备（如主设备），通常选择内部生成。MSC711x巧妙地利用其Timer B模块作为时钟源。Timer B的输入可以是APB时钟（通常为内核频率的一半）或外部时钟，经过预分频器和比较寄存器，可以产生非常灵活的时钟频率。

假设我们需要一个标准的8.192 MHz TDM位时钟（这是8 kHz帧频、8位时隙、128通道的典型时钟），而SC1400内核运行在200 MHz，APB时钟则为100 MHz。计算过程如下：

  1. 目标位时钟频率：f_bit = 8.192 MHz
  2. Timer B需要输出一个方波，其翻转频率是位时钟频率的两倍（因为每个位周期需要一个上升沿和一个下降沿），即f_toggle = 2 * f_bit = 16.384 MHz。
  3. Timer B的输入时钟f_in = 100 MHz。
  4. 比较寄存器（TMRBCMP1）的值决定了多少个输入时钟周期后翻转输出。计算公式为：Compare_Value = f_in / f_toggle = 100 MHz / 16.384 MHz ≈ 6.1035。
  5. 取整后，设置TMRBCMP1 = 6。这样产生的实际频率约为100 MHz / (2 * 6) = 8.333 MHz，与目标有微小偏差。对于严格的电信应用（如E1/T1），这点偏差可能无法接受，此时必须选择能被目标频率整数分频的输入时钟源，例如使用专用的外部晶振作为Timer的时钟源。

帧同步生成则完全由TDM模块内部的帧同步发生器完成。它基于位时钟工作：首先根据TDMxTFP/RFP[TCS/RCS]设置的通道宽度（8或16位），将位时钟分频得到“字时钟”（Word Clock），标志每个时隙的开始。然后，再根据TDMxTFP/RFP[TNCF/RNCF]设置的每帧时隙数（最大128，且必须为偶数），将字时钟分频，最终产生帧同步信号。例如，8.192 MHz位时钟、8位时隙、128通道，帧同步频率就是8.192 MHz / 8 / 128 = 8 kHz。

帧同步的极性（高有效/低有效）、长度（1位或多位周期）以及相对于数据位的延迟（0-3位），都可以通过TDMxTIR/RIR寄存器精细配置，以匹配不同厂商的编解码器或Framer芯片的时序要求。

3. TDM配置实战：从寄存器到波形

理论说再多，不如一行代码。我们以一个典型的应用场景为例：配置TDM0工作在内部环回（Loopback）模式，位时钟8.192 MHz，帧频8 kHz，每帧128个时隙，使用其中16个活跃的8位通道。这个配置常用于自测试和初步调试。

3.1 关键寄存器配置详解

配置TDM，本质上是配置一组寄存器。我们需要关注以下几个核心寄存器：

  1. TDM0通用接口寄存器（TDM0GIR）：设置全局模式。对于内部环回，我们设置LPBK=1。同时，为了简化，让发送和接收部分共享时钟和帧同步（CTS=1,RTS=1）。这样，我们只需要使用TDM0TCK、TDM0TFS、TDM0TD和TDM0RD这四根线（实际上环回时TD内部连接到RD）。
  2. TDM0接收接口寄存器（TDM0RIR）：控制接收侧行为。
    • RFEN=1, RWEN=1：启用接收FIFO并设置为宽模式（64位访问）。
    • RFWM=00：FIFO中只要有1个数据就产生“FIFO满”事件，触发DMA请求。这保证了最低延迟。
    • RCOE=1, RSO=1：时钟和帧同步配置为输出（因为我们是主设备）。
    • RSL=0, RSA=0：帧同步脉冲高电平有效，持续1个位时钟周期。
    • RFSE=1：帧同步信号在时钟下降沿被驱动（输出）或采样（输入）。
    • RDE=0：接收数据在时钟上升沿采样。这是最常用的模式。
  3. TDM0发送接口寄存器（TDM0TIR）：在环回模式下，发送侧配置必须与接收侧完全一致，以保证时序匹配。因此其设置与TDM0RIR相同。
  4. TDM0接收/发送帧参数寄存器（TDM0RFP/TDM0TFP）：
    • RNCF/TNCF = 0x7F：表示每帧有128个时隙（0x7F + 1）。
    • RCS/TCS = 00：每个通道（时隙）为8位数据。

将这些设置转化为代码，如下所示：

void InitTDMParams(void) { TDM *pstTDM0; pstTDM0 = (TDM *)(TDM0_BASE); // 配置TDM0通用接口：环回模式，收发共享时钟和同步 // LPBK=1, RTS=1, CTS=1 pstTDM0->vuliGIR = 0x00000007; // 配置接收接口寄存器 (RIR) // RFEN=1, RWEN=1, RFWM=00, RSO=1, RSL=0, RSA=0, RCOE=1, RDMA=1, RDE=0, RFSE=1 pstTDM0->vuliRIR = 0x0000E242; // 配置发送接口寄存器 (TIR)，设置与RIR一致 // TFEN=1, TWEN=1, TFWM=00, TSO=1, TSL=0, TSA=0, TCOE=1, TDMA=1, TDE=0, TFSE=1 pstTDM0->vuliTIR = 0x0000E242; // 配置接收帧参数：128时隙，8位/通道 // RNCF=0x7F (128 slots), RCS=00 (8-bit) pstTDM0->vuliRFP = 0x007f0000; // 配置发送帧参数：128时隙，8位/通道 // TNCF=0x7F, TCS=00 pstTDM0->vuliTFP = 0x007f0000; }

3.2 时序波形验证

配置完成后，最直观的验证方法就是用示波器或逻辑分析仪抓取TDM0TCK、TDM0TFS和TDM0TD的波形。根据上面的配置，你应该能看到：

  • TDM0TCK：一个8.192 MHz（或接近）的方波。
  • TDM0TFS：一个8 kHz的脉冲信号，每个脉冲高电平持续恰好一个TDM0TCK周期。脉冲的下降沿（因为RFSE=1）标志着帧的开始。
  • TDM0TD：在TDM0TFS有效后的第一个TDM0TCK上升沿（因为TDE=0），开始输出第一个时隙（通道0）的最高位（MSB）。数据会连续传输128个时隙，每个时隙8位。

调试技巧：先环回，再外联在连接外部设备（如编解码器）之前，强烈建议先在内部环回模式下进行测试。你可以让DMA向TDM发送缓冲区写入一个已知的模式（例如递增的数列），然后配置DMA从TDM接收缓冲区读取数据。如果读回的数据与发送的完全一致，就证明TDM模块的时钟、帧同步、数据通路配置都是正确的。这能极大降低硬件联调的复杂度，把问题隔离在软件配置层面。

4. DMA引擎配置精要：数据搬运的自动化流水线

TDM接口把数据收发了，但数据还躺在它的数据寄存器（TDMxRDR/TDMxTDR）里。我们需要DMA这个“搬运工”把它们及时地搬到内存中供CPU处理，或者把内存中处理好的数据搬到TDM接口发送出去。MSC711x的DMA控制器功能强大，支持复杂的传输描述符（TCD），能实现自动化的、无需CPU干预的数据搬运。

4.1 DMA通道与TDM的映射关系

首先，要记住TDM模块与DMA通道的固定映射关系，这是硬件决定的：

DMA 通道TDM 分配
0TDM0 发送
1TDM0 接收
2TDM1 发送
3TDM1 接收
12TDM2 发送
13TDM2 接收

例如，如果你想用DMA来处理TDM0的接收数据，就必须使用DMA通道1。发送则使用通道0。

4.2 核心概念：交织(Interleaved) vs 解交织(Deinterleaved)

这是TDM数据处理中最关键的概念之一，决定了数据在内存中的排列方式，也直接影响后续算法处理的效率。

  • 交织数据：这是数据从TDM接口出来的“自然”顺序。内存中，一个帧的所有通道数据连续存放。即：[帧0,通道0], [帧0,通道1], ..., [帧0,通道127], [帧1,通道0], [帧1,通道1], ...。如果你需要对完整的帧进行整体处理（如某些帧级别的加密或封装），这种格式很方便。
  • 解交织数据：这是按通道组织的顺序。内存中，同一个通道的所有帧数据连续存放。即：[通道0,帧0], [通道0,帧1], ..., [通道0,帧N], [通道1,帧0], [通道1,帧1], ...。如果你需要对每个通道进行独立的处理（如每路语音单独做增益控制、滤波），这种格式是最高效的，因为同一通道的数据在内存中是连续的，缓存命中率高。

DMA控制器通过巧妙配置传输属性（SSIZE/DSIZE）、地址偏移（SOFF/DOFF）和次循环字节数（NBYTES），可以自动完成这两种格式的转换。

4.3 实战一：使用DMA接收交织数据

假设我们配置TDM为16个活跃的8位通道。TDM每次会收满8个字节（64位，对应8个通道）后，才产生一次“接收FIFO满”事件，触发DMA传输。因此，DMA的每次传输（次循环）就是搬运这8个字节。

我们需要配置DMA通道1（TDM0接收）的传输控制描述符（TCD）：

  • SADDR：源地址固定为TDM0RDR的AHB总线地址（TDM0AHB_BASE）。
  • DADDR：目的地址是我们的接收缓冲区首地址。注意：如果缓冲区在M1内存（0x01800000起始），需要在地址上加上这个偏移。
  • SOFF：源地址偏移为0，因为每次都是从同一个TDM0RDR寄存器读。
  • DOFF：目的地址偏移为8。因为第一次DMA传输搬了通道0-7的数据到缓冲区起始位置，下一次传输搬通道8-15的数据，需要放在偏移8字节的地方。
  • SSIZE/DSIZE：传输大小都设为64位（0x3），因为TDM FIFO是64位宽，一次读8字节效率最高。
  • NBYTES：次循环字节数设为8。
  • CITER/BITER：主循环次数。假设我们要接收80帧数据。总字节数 = 80帧 × 16通道/帧 × 1字节/通道 = 1280字节。每次DMA传输搬8字节，所以需要1280 / 8 = 160次传输。CITER和BITER都设为160。
  • DLAST_SGA：当主循环（160次传输）完成后，DMA会自动将目的地址DADDR调整DLAST_SGA的值。这里我们设为-1280，这样目的地址就回到了缓冲区开头，实现了环形缓冲，可以持续接收新数据覆盖旧数据。
// 接收交织数据的DMA通道1配置示例 pstDMA->astTCD[1].vuliSAddr = TDM0AHB_BASE; // 源：TDM接收寄存器 pstDMA->astTCD[1].vusiTransferAttr = 0x0303; // SSIZE=64位, DSIZE=64位 pstDMA->astTCD[1].vusiSOff = 0; // 源地址固定 pstDMA->astTCD[1].vuliNBytes = 8; // 每次传8字节 pstDMA->astTCD[1].vuliSLast = 0; // 源地址最后不调整 UWord32 addr = (UWord32)(&Rx_Interleaved_Buffer); pstDMA->astTCD[1].vuliDAddr = COMP_DMA_ADDR(addr); // 目的：交织缓冲区 #define SZ_BUF (80 * 16 * 1) // 1280字节 pstDMA->astTCD[1].vusiCIter = SZ_BUF / 8; // 主循环次数=160 pstDMA->astTCD[1].vusiDOff = 8; // 每次传输后，目的地址+8 pstDMA->astTCD[1].vuliDLastSGA = -(SZ_BUF); // 主循环后，目的地址回退1280字节 pstDMA->astTCD[1].vusiBIter = pstDMA->astTCD[1].vusiCIter; // BITER = CITER

这种配置的优点是DMA可以无限循环，自动覆盖缓冲区，实现“乒乓操作”，CPU只需要定期来读取处理好的数据块即可。缺点也很明显：数据是交织的，如果要对某个特定通道进行连续处理，就需要在内存中“跳着”访问数据，缓存效率低，软件处理开销大。

4.4 实战二：使用DMA直接接收解交织数据

解交织模式更符合多通道独立处理的直觉。DMA配置的巧妙之处在于，它通过一次读取（8字节），然后执行多次不同目的地址的写入来实现解交织。

关键配置变化在于：

  • DSIZE：目的传输大小设为8位（0x0），而不是64位。这意味着DMA控制器从TDM0RDR一次读取8字节后，会将其拆分成8次独立的1字节写入操作。
  • DOFF：目的地址偏移设为每个通道缓冲区的大小。假设我们为16个通道分别分配了缓冲区，每个缓冲区存放80帧数据（80字节）。那么DOFF就设置为80。这样，第一次写入的1字节（通道0数据）进入通道0缓冲区的第0个位置；第二次写入的1字节（通道1数据）会写入通道1缓冲区的第0个位置，地址正好偏移了80字节；以此类推。
  • CITER/BITER：现在，每次DMA请求（对应TDM收满8个通道）只能完成一帧内8个通道的数据摆放。要收齐一帧16个通道的数据，需要2次DMA请求。所以CITER设为2。CITER减到0，表示一帧数据收齐，触发主循环结束。
  • DLAST_SGA：主循环结束后，我们需要把目的地址调整到下一个帧的起始位置。当前目的地址指向的是通道7缓冲区的第0个位置（假设刚写完一帧）。下一帧通道0的数据应该写到通道0缓冲区的第1个位置。所以地址需要回退(总缓冲区大小 - 一个通道缓冲区大小)。总缓冲区大小是16通道 * 80字节/通道 = 1280字节，一个通道缓冲区是80字节，所以DLAST_SGA = -(1280 - 80) = -1200。这样，下一次主循环开始时，目的地址又指向了通道0缓冲区的下一个位置（索引1）。
// 接收解交织数据的DMA通道1配置示例 pstDMA->astTCD[1].vuliSAddr = TDM0AHB_BASE; // 源：TDM接收寄存器 pstDMA->astTCD[1].vusiTransferAttr = 0x0300; // SSIZE=64位, DSIZE=8位 pstDMA->astTCD[1].vusiSOff = 0; pstDMA->astTCD[1].vuliNBytes = 8; // 一次读8字节 pstDMA->astTCD[1].vuliSLast = 0; UWord32 addr = (UWord32)(&Rx_Deinterleaved_Buffer[0][0]); // 指向通道0缓冲区起始 pstDMA->astTCD[1].vuliDAddr = COMP_DMA_ADDR(addr); #define NUM_CH 16 // 通道数 #define SZ_CH 80 // 每个通道缓冲区的帧容量（字节） #define NUM_FRM 80 // 总帧数 pstDMA->astTCD[1].vusiCIter = 2; // 收齐一帧(16通道)需要2次DMA请求 pstDMA->astTCD[1].vusiDOff = SZ_CH * NUM_FRM; // 80，跳到下一个通道的缓冲区 pstDMA->astTCD[1].vuliDLastSGA = -( (SZ_CH * NUM_FRM * NUM_CH) - (SZ_CH * NUM_FRM) ); // -1200 pstDMA->astTCD[1].vusiBIter = pstDMA->astTCD[1].vusiCIter;

核心要点：理解NBYTES与SSIZE/DSIZE的配合NBYTES定义了一次“次循环”要搬运的总字节数。而SSIZE和DSIZE定义了每次“读”或“写”操作的粒度。在解交织例子中，NBYTES=8，SSIZE=64位，所以DMA执行1次64位读操作，从源地址读取8字节。DSIZE=8位，所以DMA接着执行8次8位写操作，将刚读来的8字节依次写入8个不同的目的地址（由DADDR和DOFF决定）。这个过程完全由DMA硬件自动完成，效率极高。

4.5 高级技巧：链接通道实现定期中断

在很多应用中，我们不想让DMA无限循环，而是希望每收集完N帧数据后，通知CPU来进行批量处理（例如，每10ms处理80帧）。这可以通过DMA的通道链接（Channel Linking）功能实现。

思路是：让负责数据搬运的DMA通道（如通道1）在完成一次主循环（即收齐一帧解交织数据）后，自动启动另一个“辅助”DMA通道（例如通道6）。这个辅助通道不执行实际的数据传输，只作为一个计数器。我们配置它的CITER为N（例如4），并启用主循环完成中断（INT_MAJ）。这样，当通道1每完成一帧传输，就触发通道6执行一次“传输”（实际上是计数减一）。当通道6的CITER从4减到0时，就会产生一个DMA中断，此时CPU就知道已经收集了4帧数据，可以进行处理了。

配置要点：

  1. 在通道1的TCD中，设置MAJOR.E_LINK=1，并设置MAJOR.LINKCH=6，使其主循环完成后链接到通道6。
  2. 配置通道6的TCD：SADDR和DADDR可以指向一个虚拟的缓冲区（dummy buffer）。SSIZE/DSIZE任意，NBYTES任意（例如8）。关键是CITER设为想要的帧数N（例如4），并设置INT_MAJ=1。
  3. 在DMA中断服务程序（ISR）中，判断是通道6的中断，即可进行数据处理，并重新使能通道1和通道6（或重新赋值CITER/BITER）以开始下一轮收集。
// 配置通道1，使其主循环后链接到通道6 pstDMA->astTCD[1].vusiChannelCtrlStat |= 0x0020; // 设置 MAJOR.E_LINK=1 // 注意：LINKCH字段通常在TCD的另一个字中，这里仅为示意，实际需查寄存器手册。 // 配置通道6作为计数器 UWord32 dummy_addr = (UWord32)(&dummy_buffer); pstDMA->astTCD[6].vuliSAddr = COMP_DMA_ADDR(dummy_addr); pstDMA->astTCD[6].vuliDAddr = COMP_DMA_ADDR(dummy_addr); pstDMA->astTCD[6].vusiTransferAttr = 0x0303; // 传输属性随意 pstDMA->astTCD[6].vuliNBytes = 8; pstDMA->astTCD[6].vusiCIter = 4; // 每4帧中断一次 pstDMA->astTCD[6].vusiBIter = 4; pstDMA->astTCD[6].vusiChannelCtrlStat = 0x0002; // INT_MAJ=1，启用主循环完成中断

这种方法将CPU从轮询缓冲区的任务中彻底解放，实现了基于事件的、准确定时的批处理，是构建高效实时系统的关键。

5. 系统调优与避坑指南

配置通了只是第一步，要让系统稳定高效地跑起来，还需要进行细致的调优。

5.1 DMA优先级与仲裁

MSC711x的DMA控制器有多个通道，当多个通道同时请求时，需要通过优先级仲裁。优先级在DMA_CPRx寄存器中设置。对于TDM这种实时数据流，必须将其对应的DMA通道设置为最高优先级。因为TDM数据流是连续不断的，如果DMA响应不及时，就会导致FIFO上溢或下溢，造成数据丢失或错误。

例如，TDM0接收（通道1）和发送（通道0）的优先级应该设为最高（如0级或1级）。同时，要避免让高带宽、高优先级的DMA通道（如与SDRAM交互的通道）长时间霸占总线，这可能会阻塞TDM DMA的访问。有时需要调整不同内存访问的突发长度（Burst Size）来优化总线利用率。

5.2 交叉开关（Crossbar Switch）调优

MSC711x内部有多条总线（如AHB、APB、ASTH），通过交叉开关互联。TDM模块通过ASTH总线与内存交互。你需要确保TDM和DMA访问的内存（通常是M1 SRAM）在交叉开关中的配置是最优的，例如使能预取（Prefetch）和缓冲（Buffer）功能，以减少访问延迟。

5.3 常见问题排查

  1. 没有数据或数据全零：

    • 检查时钟和帧同步：用示波器测量TDMxTCK和TDMxTFS引脚，确认波形、频率、极性符合预期。这是最常见的问题根源。
    • 检查环回模式：先配置为内部环回，用DMA自发自收，验证TDM和DMA基础配置是否正确。
    • 检查GPIO配置：确认PxCTL、PxDDR、DEVCFG寄存器配置正确，引脚确实被切换到了TDM功能。
    • 检查DMA启动：确认在配置完TCD后，向相应通道的DMA_CSR寄存器写入了启动命令。

  2. 数据错位或混乱：

    • 检查帧同步延迟：TDMxTIR/RIR中的TFSD/RFSD位控制帧同步信号相对于数据的延迟（0-3位）。如果外部设备时序特殊，可能需要调整这个值。
    • 检查数据边沿：确认TDE和RDE（数据驱动/采样边沿）与外部设备匹配。通常上升沿采样，但有些设备可能相反。
    • 检查字节序：TDMxTIR/RIR中的TBO/RBO位控制MSB/LSB先行。确保与通信对方一致。

  3. DMA传输不连续或丢失数据：

    • 检查FIFO水位：如果TFWM/RFWM设置得太“深”（比如FIFO快满/快空才触发），而DMA响应延迟较大，可能导致FIFO上溢或下溢。尝试调低水位值。
    • 检查DMA优先级：确保TDM DMA通道优先级足够高，不会被其他DMA操作长时间阻塞。
    • 检查CITER和BITER：确保它们被正确赋值且不为0。BITER是初始值，CITER是当前值，每次主循环完成后，硬件会将CITER重新加载为BITER。如果BITER为0，通道会在完成一次后就停止。
    • 检查DLAST_SGA和SLAST：在循环缓冲模式下，这两个值必须正确设置，以保证地址能正确回绕。计算错误会导致DMA写到非预期的内存区域，造成数据覆盖或系统崩溃。

  4. 中断无法产生：

    • 检查中断使能：除了在DMA TCD中设置INT_MAJ，还需要在DMA控制器全局中断使能寄存器以及内核的中断控制器（INTC）中使能对应的DMA通道中断。
    • 检查链接配置：如果使用通道链接产生中断，务必确认源通道的MAJOR.E_LINK和MAJOR.LINKCH设置正确，并且目标通道已正确配置并启用。

调试这类问题，善用芯片的仿真器和内存观察窗口至关重要。你可以单步执行初始化代码，查看每个寄存器的值是否与预期一致。在DMA运行后，观察目的缓冲区的数据是否按预期更新。同时，结合示波器观察硬件信号，能快速定位是软件配置问题还是硬件连接问题。

http://www.cnnetsun.cn/news/2846799.html

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