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深入解析TI C2000 SCI寄存器：从原理到实战的嵌入式串口通信指南

news 2026/7/18 10:20:09

1. 项目概述与核心价值

串行通信接口，也就是我们常说的SCI，或者更通俗的UART，可以说是嵌入式工程师的“老朋友”了。无论是给设备打印调试信息，还是两个微控制器之间“说悄悄话”，都离不开它。但很多时候，我们只是调用现成的库函数，配置一下波特率、数据位、停止位就完事了，对底层那些寄存器到底在忙活些什么，可能只有一个模糊的概念。直到某天，通信突然出现偶发的乱码，或者功耗异常，又或者需要实现一些非标准的唤醒机制时，我们才不得不翻开那几百页的技术参考手册，在一堆寄存器位域描述里寻找答案。

这次，我们就以TI C2000系列微控制器中的SCI模块为例，彻底拆解其控制寄存器组。这不仅仅是一次寄存器手册的翻译，更是一次从“会用”到“懂原理”的深度探索。SCI控制寄存器，特别是SCIFLR标志寄存器和SCIPIO引脚控制寄存器，是连接软件逻辑与硬件物理层的桥梁。理解它们，意味着你能精准诊断通信故障（比如，是线路干扰导致的帧错误，还是软件处理不及时造成的溢出？），能灵活配置引脚模式以节省功耗或适配不同电平，甚至能实现高效的多处理器通信。对于从事工业控制、汽车电子或任何对通信可靠性有要求的嵌入式开发者而言，这份深入骨髓的理解是写出健壮、高效驱动代码的基石。

2. SCI控制寄存器全景与核心设计思路

在深入每个寄存器之前，我们有必要先建立全局视图。SCI模块的寄存器组是一个精心设计的控制系统，其核心设计思路可以概括为：状态感知、流程控制、硬件抽象。

状态感知主要由状态与标志寄存器（如SCIFLR）承担。它像是一个24小时不间断的监控面板，实时报告收发状态（TXRDY， RXRDY）、错误信息（FE， OE， PE）以及总线活动（BUSY， IDLE）。工程师通过查询这些标志位，可以精确掌握通信链路每一刻的健康状况。

流程控制则涉及波特率设置（BRS）、数据格式（SCIFORMAT）、中断管理（SCIINTVECT0/1）等寄存器。它们决定了通信的“节奏”和“规则”。例如，波特率寄存器的值直接决定了每个比特位的时长；格式寄存器定义了数据帧的结构；而中断向量寄存器则提供了一种高效的事件响应机制，让CPU不必频繁轮询状态。

硬件抽象层最为典型的就是SCIPIO系列引脚控制寄存器。微控制器的引脚通常是复用的，一个物理引脚可能对应着数字IO、模拟输入、外设功能等多种角色。SCIPIO寄存器组提供了一套完整的“角色扮演”开关和“属性配置”面板。通过它们，我们可以将某个引脚指定为SCI的TX或RX功能，也可以在不使用SCI时，将其配置为普通的GPIO，并设置其上拉/下拉、开漏输出等电气特性。这种设计极大地增强了硬件连接的灵活性。

整个寄存器组的设计遵循了模块化、低耦合的原则。状态寄存器只负责报告，不直接引发动作；控制寄存器只负责配置，不影响实时状态；数据寄存器则作为纯数据通道。这种清晰的职责划分，使得驱动程序的编写逻辑清晰，易于维护和调试。

3. 核心细节解析：SCIFLR标志寄存器逐位精讲

SCIFLR寄存器是SCI模块的“心脏监护仪”，每一位都对应着一个关键状态。理解每一位的置位条件、清除方式以及其影响，是进行可靠通信编程的前提。下面我们逐位进行深度解析。

3.1 错误类标志位：通信质量的“报警器”

错误标志位是排查通信故障的第一线索，包括FE（帧错误）、OE（溢出错误）和PE（奇偶校验错误）。

FE - 帧错误标志（第26位）

触发条件：当接收器在预期的时间点没有检测到有效的停止位时，该位置1。这通常意味着通信双方的波特率不匹配，或者线路受到严重干扰，导致位时序完全错乱。
深层原理：SCI接收器在采样到起始位后，会按照预设的波特率周期性地在数据位中点进行采样。在停止位周期内，它期望采样到高电平。如果采样到低电平，则判定为帧错误。在LIN模式或SCI兼容模式下此位有效。
清除方式：写入1、软件复位（SW nRST）、模块复位（RESET）、系统复位，或读取对应的中断向量偏移量（SCIINTVECT0/1）。特别注意：在SCI兼容模式下，接收一个新字符也会清除此标志；在LIN模式下，接收一个新帧会清除它。这意味着如果你不主动处理错误，后续的正确数据可能会“覆盖”掉之前的错误状态，让你错过故障信息。
实战心得：一旦发现FE频繁置位，首先应使用示波器测量TX和RX线上的实际波形，核对波特率是否精确匹配（计算误差应小于3%）。其次检查硬件连接，特别是地线是否共地良好，线路是否过长且未加终端匹配。

OE - 溢出错误标志（第25位）

触发条件：当接收移位寄存器（SCIRXSHF）中的数据已经准备好移入接收数据缓冲寄存器（SCIRD），但SCIRD中的数据尚未被CPU或DMA读取时，发生覆盖，OE置1。
深层原理：SCIRD是一个单字节或深度很浅的缓冲区。如果软件读取数据的速度跟不上接收速度，新数据就会“冲掉”旧数据，造成数据丢失。OE置位时，SCIRD中保存的是被覆盖前的老数据，新数据已丢失。
清除方式：与FE类似，写入1、各种复位或读取对应中断向量。
实战心得：OE是典型的“软件瓶颈”指示器。解决方法包括：1) 提高接收中断的优先级，确保及时响应；2) 使用DMA进行数据搬运，解放CPU；3) 检查主循环或高优先级任务是否长时间关中断，导致无法及时服务SCI接收中断。

PE - 奇偶校验错误标志（第24位）

触发条件：当使能了奇偶校验功能（SCIGCR[2]=1），且接收到的数据位中“1”的个数与奇偶校验位的预期不符时，该位置1。
深层原理：奇偶校验是一种简单的检错机制，分奇校验和偶校验。发送方会根据数据位计算一个校验位，使得整个帧（数据位+校验位）中“1”的个数为奇数（奇校验）或偶数（偶校验）。接收方进行同样的计算并比对。关键点：在地址位多处理器模式下，校验计算包含数据和地址位；在空闲线多处理器模式下，仅对数据位进行计算。
清除方式：写入1、各种复位、读取中断向量，或接收新字符/帧（取决于模式）。
实战心得：PE错误通常指示偶发的位翻转干扰，可能由电源噪声、电磁兼容性问题引起。如果PE持续发生，而FE和OE没有，说明通信时序基本正确，但信号质量不佳。需检查PCB布局、电源去耦，并考虑在软件层增加数据包校验（如CRC）。

3.2 状态与就绪标志位：流程控制的“指挥棒”

这类标志位用于协调数据收发流程，是实现查询或中断驱动编程的关键。

RXRDY - 接收就绪标志（第9位）

含义：当SCIRD寄存器中有新的数据可供读取时，硬件自动置1。这是触发接收中断或让查询式程序知道“可以取数据了”的信号。
清除方式：这是极易混淆的一点。在兼容模式下，读取SCIRD寄存器本身会自动清除RXRDY。写入1、软件/系统复位也能清除它。但特别注意：读取SCIINTVECT0/1寄存器不能清除RXRDY标志！这与FE/OE/PE等错误标志的清除方式不同。
实战心得：在中断服务程序中，标准的操作顺序是：1) 读取SCIRD获取数据；2) 处理数据。由于读SCIRD会清除RXRDY，所以无需手动写1清除。如果你在中断中先做了其他事情导致RXRDY被意外清除（如误读），可能会丢失数据。

TXRDY - 发送就绪标志（第8位）

含义：当发送数据缓冲寄存器（SCITD）为空，可以接收下一个待发送字节时，硬件置1。表示“可以放新数据了”。
清除方式：向SCITD寄存器写入数据会自动清除TXRDY。同样，各种复位也能将其置1（表示初始为空）。与RXRDY类似，读取SCIINTVECT0/1寄存器不能清除TXRDY。
实战心得：在查询式发送中，你需要循环检测TXRDY是否为1，为1则写入数据。在中断发送中，通常在中断服务程序里检查是否还有数据要发，如果有则写入SCITD，写入操作会清除TXRDY并启动发送；发送完成后，TXRDY再次置1，触发下一次中断。注意，TXRDY在数据从SCITD转移到发送移位寄存器（SCITXSHF）后置1，而非在引脚发送完成后。

TX EMPTY - 发送器空标志（第11位）

含义：这是一个更强的“空”指示。当发送缓冲寄存器（SCITD）和发送移位寄存器（SCITXSHF）都为空时，此位置1。这意味着不仅缓冲空了，连正在移出的数据也发完了，发送线路上将进入空闲状态。
清除方式：当有数据被加载到SCITD或SCITXSHF时，硬件清除此位。复位操作会将其置1。
实战心得：这个标志在需要确保一串数据完全发送完毕再执行后续操作（如切换引脚模式、进入低功耗）的场景下非常有用。例如，在发送完一个字符串后，等待TX EMPTY置1，再关闭发送器或进行其他操作，可以确保最后一个字节的停止位也已完整发出。

3.3 多处理器与唤醒控制标志位

RXWAKE - 接收唤醒检测标志（第12位）TXWAKE - 发送唤醒方法选择（第10位）这两个位用于支持多处理器通信模式（空闲线模式或地址位模式）。

RXWAKE：当接收到的帧被识别为地址帧（在地址位模式中地址位为1；在空闲线模式中，该帧前有长空闲周期）时，硬件置1。它告诉CPU：“刚收到的这个字节是地址，不是普通数据”。
TXWAKE：由软件控制。在写入数据到SCITD之前，先设置TXWAKE为1，则接下来发送的帧会被标记为地址帧。发送硬件在发送完该地址帧后，会自动清除TXWAKE。
实战心得：在多机网络中，从机通常初始化时只打开地址匹配中断。当主机发送一个地址帧时，所有从机的RXWAKE都会置1并产生中断。从机在中断中读取地址并与自身地址比较，若匹配，则使能数据接收，开始监听后续的数据帧；若不匹配，则保持静默。这是一种高效的广播-寻址通信机制。

WAKEUP - 唤醒标志（第1位）

含义：当SCI模块因收发器活动而从低功耗模式中被唤醒时，此位置1。
实战心得：在低功耗应用中，可以配置SCI在空闲时进入休眠，并开启WAKEUP中断。当总线上有活动（起始位）时，SCI模块自动唤醒并置位此标志，产生中断，通知CPU开始接收数据。这是实现超低功耗串口监听的关键。

3.4 总线活动标志位

BUSY - 总线忙标志（第3位）

含义：接收器一旦检测到起始位，即置1；完整接收一帧后，清零。它指示了物理线路上是否正在传输数据。
实战心得：结合IDLE位，可以用于总线监控和诊断。例如，如果BUSY长时间为1，可能意味着线路被拉低（break状态）或发生了持续的冲突。

IDLE - 接收器空闲状态标志（第2位）

含义：当接收器处于空闲状态（例如复位后、退出低功耗后），等待检测到11个位周期的空闲时间（即一个完整的字符时间加上）以重新同步时，此位置1。在此期间，接收器不接收数据。
实战心得：在通信初始化或唤醒后，软件可以查询此位，直到其变为0，确保接收器已同步就绪，然后再开始发送或期待接收数据。这避免了在接收器未准备好时发送数据导致的首字节丢失问题。

BRKDT - 间隔检测标志（第0位）

触发条件：在检测到帧错误（FE）后，如果SCIRX引脚持续保持低电平超过10个位时间，则判定为间隔（Break）条件，此位置1。
实战心得：间隔信号是一种特殊的通信信号，常用于LIN总线中表示帧头，或作为复位、唤醒的强命令。处理BRKDT中断时，通常需要执行一些特殊的协议解析或系统状态重置操作。

4. 引脚配置实战：SCIPIO寄存器组深度应用

SCI的收发引脚（SCITX， SCIRX）通常是多功能引脚。SCIPIO寄存器组提供了从功能选择、方向控制、数据读写到电气属性配置的全套控制能力。理解它们，你就能让一个引脚在不同的应用场景下“变身”。

4.1 功能复用与方向控制：角色扮演开关

配置一个引脚，首先要决定它扮演什么角色，以及如果是GPIO，它的数据流向。

SCIPIO0: 功能选择寄存器

TX FUNC (位2)：0 = 引脚作为通用GPIO；1 = 引脚作为SCI发送引脚（SCITX）。
RX FUNC (位1)：0 = 引脚作为通用GPIO；1 = 引脚作为SCI接收引脚（SCIRX）。
配置顺序：通常，在系统初始化时，先配置此寄存器将引脚功能切换到SCI，再进行其他SCI模块的配置。如果需要将引脚用作GPIO，则先在此处切换为GPIO功能，再通过SCIPIO1等寄存器控制方向。

SCIPIO1: 方向控制寄存器

TX DIR (位2)：当TX FUNC=0（GPIO模式）时，此位决定方向。0=输入，1=输出。
RX DIR (位1)：当RX FUNC=0（GPIO模式）时，此位决定方向。0=输入，1=输出。
重要提示：当引脚配置为SCI功能（TX/RX FUNC=1）时，方向是硬件自动管理的（TX为输出，RX为输入），此寄存器的值无效。

4.2 数据读写：观察与控制引脚电平

即使引脚用作SCI功能，有时我们也需要读取或强制其电平，用于测试或特殊协议。

SCIPIO2: 输入数据寄存器

TX IN (位2)/RX IN (位1)：只读位。无论引脚配置为何种功能（SCI或GPIO），读取此位都能获得引脚当前的实际电平。这对于诊断非常有用，例如，可以判断发送引脚是否真的输出了高电平，或者接收引脚是否被外部电路拉低。

SCIPIO3: 输出数据寄存器

TX OUT (位2)/RX OUT (位1)：当引脚配置为GPIO输出模式（TX/RX FUNC=0 且 TX/RX DIR=1）时，向此位写入0或1，即可控制引脚输出低电平或高电平。
SCIPIO4 (SET) 和 SCIPIO5 (CLR)：这是两个便捷操作寄存器。当引脚为GPIO输出模式时，向TX SET/RX SET位写1，相当于将对应的TX OUT/RX OUT位置1（输出高电平）；向TX CLR/RX CLR位写1，相当于将对应的TX OUT/RX OUT位清0（输出低电平）。而写0则无效果。这种“置位/清零”寄存器在需要原子操作（如置位一个标志而不影响其他位）时非常方便，但在简单控制中，直接读写SCIPIO3更直观。

4.3 电气特性配置：适应不同的硬件环境

这是高级应用，关系到信号的完整性、功耗和驱动能力。

SCIPIO6: 开漏输出使能寄存器

TX PDR / RX PDR：当引脚为GPIO输出模式时，此位控制输出级结构。0=推挽输出（可主动输出高电平和低电平）；1=开漏输出（只能主动拉低，高电平靠外部上拉电阻实现）。
实战应用：1)电平转换：与5V器件通信时，MCU引脚配置为开漏模式，外部上拉到5V，通过钳位二极管保护，可实现3.3V到5V的电平转换。2)总线“线与”：在I2C等总线中，必须使用开漏模式以实现多设备共享总线。

SCIPIO7 与 SCIPIO8: 上下拉控制寄存器

TX PD / RX PD (SCIPIO7)：上/下拉使能控制。0=使能内部上拉/下拉；1=禁用内部上拉/下拉。
TX PSL / RX PSL (SCIPIO8)：上/下拉类型选择。0=下拉；1=上拉。
配置逻辑：先通过SCIPIO8选择上拉还是下拉，再通过SCIPIO7使能它。禁用内部上下拉后，引脚状态完全由外部电路决定。
实战心得：对于SCI接收引脚（RX），在悬空或可能受到干扰时，使能一个下拉电阻（通常几十kΩ）是个好习惯，可以将空闲状态稳定在低电平，避免因噪声误触发起始位。对于发送引脚（TX），如果外部已经接了上拉，通常需要禁用内部上拉以避免冲突。具体配置需参考硬件原理图。

5. 关键寄存器联动与典型配置流程

理解了单个寄存器后，我们来看它们如何协同工作。下面是一个典型的SCI初始化配置流程，涵盖了从引脚配置到通信就绪的全过程。

5.1 初始化配置步骤

引脚复用配置：这是第一步，确保物理引脚连接到SCI模块内部。
- 通过SCIPIO0寄存器，将TX FUNC和RX FUNC位置1，将引脚功能切换到SCI。如果芯片有独立的引脚复用控制寄存器（例如GPIO MUX），也需要相应配置。
SCI模块软复位：在修改关键配置前，进行一次软复位是一个好习惯，确保模块处于已知的干净状态。
- 向SCIGCR1寄存器中的SW nRST位写0（如果存在），保持一段时间后再置1。这会复位大部分内部状态机和寄存器。
配置通信参数：
- 波特率：根据系统时钟频率（VCLK）和目标波特率，使用公式BAUD = (VCLK / (波特率 * 16)) - 1（异步模式）计算24位BAUD值，并写入BRS寄存器。务必使用整数运算，并检查误差（手册中Table 26-17提供了参考值）。
- 数据格式：配置SCIFORMAT寄存器。设置CHAR位域，选择数据位长度（1-8位）。同时，通过SCIGCR等寄存器配置停止位数量（通常1或2位）、是否使能奇偶校验（及奇偶类型）、以及选择多处理器通信模式（如需要）。
配置引脚电气属性（可选但推荐）：
- 根据硬件设计，配置SCIPIO7和SCIPIO8，为RX引脚设置一个合适的上拉或下拉（通常下拉），以稳定空闲状态。禁用不必要的上下拉以降低功耗。
使能SCI模块与收发器：
- 在SCIGCR1寄存器中，将SCIEN（SCI使能）位置1。
- 将TXENA（发送使能）和RXENA（接收使能）位置1，激活收发器。
中断配置（如果使用中断）：
- 清除可能挂起的中断标志（SCIFLR）。
- 在SCISETINT寄存器中，使能所需的中断，例如SET RX INT（接收中断）、SET TX INT（发送中断）或错误中断。
- 在CPU级别，配置好SCI中断向量，并使能全局中断。

5.2 数据收发操作流程

查询式发送：

while((SCIFLR & (1 << 8)) == 0); // 等待 TXRDY 置1 SCITD = data_to_send; // 写入数据，自动清除TXRDY并启动发送

中断式发送：

初始化时使能SET TX INT。
发送函数将数据放入一个软件缓冲区，并检查如果发送器空闲（TXRDY为1且软件缓冲区有数据），则写入SCITD启动首次发送。
此后，每次SCITD数据移入移位寄存器后，TXRDY会再次置1，触发发送中断。在中断服务程序中，从软件缓冲区取出下一个数据写入SCITD，直到缓冲区空，然后关闭发送中断。

查询式接收：

if((SCIFLR & (1 << 9)) != 0) { // 检查 RXRDY received_data = SCIRD; // 读取数据，自动清除RXRDY // 处理数据... }

中断式接收：

初始化时使能SET RX INT。
当SCIRD收到新数据，RXRDY置1，触发接收中断。
在中断服务程序中，直接读取SCIRD获取数据，并存入环形缓冲区。主循环从环形缓冲区中取出处理。切记：中断服务程序应尽可能短，只做数据搬运和标志检查。

5.3 错误处理框架

一个健壮的SCI驱动必须包含错误处理。建议在接收中断或主循环定时检查中，加入错误标志检查：

uint32_t flags = SCIFLR; if(flags & (1 << 26)) { // FE 帧错误 // 1. 记录错误日志 // 2. 可选的自动恢复：清除标志(SCIFLR |= (1<<26);) // 3. 可能需要重新同步或复位通信 handle_framing_error(); } if(flags & (1 << 25)) { // OE 溢出错误 // 1. 记录错误，表明有数据丢失 // 2. 检查软件接收缓冲区是否已满，或中断响应是否太慢 // 3. 清除标志 handle_overrun_error(); } if(flags & (1 << 24)) { // PE 奇偶校验错误 // 1. 记录错误 // 2. 丢弃或标记该帧数据为不可靠 // 3. 清除标志 handle_parity_error(); } // 清除错误标志的通用方法：写1清除 SCIFLR = (flags & (0x07 << 24)); // 清除FE, OE, PE位

6. 常见问题排查与实战技巧实录

即使理解了所有寄存器，在实际调试中依然会遇到各种问题。下面是我在多年项目中总结的一些典型问题与解决思路。

6.1 通信完全不通，无数据收发

检查清单：
1. 物理层：TX和RX线是否接反？电平是否匹配（如3.3V与5V）？地线是否连通？这是最常见的问题。
2. 时钟与波特率：确认MCU的系统时钟和外设时钟（VCLK）配置正确。使用示波器测量TX引脚，检查实际发出的波特率是否与预期一致。一个快速验证方法是让MCU持续发送0x55（二进制01010101），用示波器测量一个位的时间，其倒数即为实际波特率。
3. 引脚复用：确认SCIPIO0寄存器中的TX FUNC和RX FUNC位已设置为1。同时检查芯片的全局引脚复用控制寄存器是否已将引脚映射到SCI功能。
4. 模块使能：确认SCIGCR1中的SCIEN、TXENA、RXENA位已置1。
5. 软件流控：如果硬件流控（RTS/CTS）被启用，但未连接，会导致通信阻塞。检查相关控制寄存器，确保流控被禁用，除非你明确需要使用它。

6.2 能发送但不能接收，或接收数据乱码

排查思路：
1. 中断与标志：如果使用中断接收，确认中断向量配置正确，且全局中断已开启。在中断服务程序中，是否正确地读取了SCIRD？读取操作会清除RXRDY，如果忘记读，下次中断可能不会触发。
2. 波特率容错：即使计算值正确，时钟源的精度（晶振误差、PLL抖动）也会引入误差。确保收发双方的波特率误差在可接受范围内（通常要求小于3%）。尝试略微调整BAUD值。
3. 数据对齐：当数据位少于8位时（通过SCIFORMAT设置），接收到的数据在SCIRD中是左对齐的，高位补0。软件需要手动右移才能得到正确值。例如，设置5位数据，接收值0x68（二进制0110 1000），实际数据是01101，右移3位后得到0x0D。
4. 噪声与干扰：在工业环境中，长导线可能引入噪声。检查PE（奇偶校验错误）标志是否置位。考虑在软件层为数据包增加帧头、帧尾和CRC校验。硬件上可以增加滤波电容或使用差分串口（如RS-485）。

6.3 低功耗模��下的SCI唤醒问题

关键配置：
1. 唤醒源使能：进入低功耗前，确保SCISETINT寄存器中的SET WAKEUP INT位已置1，使能唤醒中断。
2. 正确进入低功耗：在确认TX EMPTY（发送完成）且BUSY为0（总线空闲）后，再让CPU进入低功耗模式。否则可能丢失正在发送的数据或无法唤醒。
3. 唤醒后的处理：唤醒中断发生后，WAKEUP标志会置1。在中断服务程序中，需要先读取SCIFLR或SCIINTVECTx寄存器来清除这个标志，然后才能正常进行数据收发。有时模块从低功耗唤醒需要一点时间重新同步，可以短暂延时或等待IDLE位清零后再开始通信。

6.4 多处理器通信模式配置要点

模式选择：地址位模式（Address-bit）和空闲线模式（Idle-line）是两种不同的寻址方式。地址位模式在每个数据帧中增加一个地址/数据标识位；空闲线模式则用一段长的空闲时间（大于10个位时间）来分隔地址帧和数据帧。根据你的协议要求选择。
地址匹配：从机需要实现地址匹配逻辑。通常，在初始化时只使能RXRDY中断，并在中断中检查RXWAKE标志。如果RXWAKE=1，则读取收到的地址字节与自身地址比较。若匹配，则使能所有接收中断（包括数据接收）；若不匹配，则忽略后续数据（直到下一个地址帧）。
TXWAKE的使用：主机在发送地址帧前，需要先设置TXWAKE=1，然后写入地址到SCITD。硬件发送完该地址帧后会自动清除TXWAKE。后续发送数据帧时，TXWAKE保持为0即可。

6.5 一个高级技巧：利用SCIPIO2诊断硬件连接

当你怀疑硬件连接有问题，但又没有逻辑分析仪时，可以巧妙使用SCIPIO2寄存器。将TX和RX引脚短接，编写一个自发自收的程序。在发送数据的同时，不断读取SCIPIO2中的TX IN和RX IN位。理论上，它们应该读到相同的值。如果不同，则说明引脚配置、外部电路或PCB走线可能有问题。这相当于一个简单的内部环回测试。

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